La famiglia di processori VIA Nano si serve del bus ad alta efficienza VIA V4 e introduce alcune nuove features:

  • Microarchitettura superscalare ad esecuzione speculativa fuori ordine a 64-bit: Supporta un completo set d’istruzioni a 64-bit e fornisce funzionalità macro-fusion e micro-fusion nonché sofisticate funzioni di branch prediction per una maggiore efficienza energetica e migliori prestazioni.

  • High-Performance Computation e Media Processing: L’alta velocità, il VIA V4 Front Side Bus low power a partire da 800MHz, la performante unità di calcolo in virgola mobile, il supporto alle nuove istruzioni SSE, e due cache L1 da 64KB ed un’esclusiva cache L2 da 1 MB associativa a 16 vie, assicurano un notevole incremento delle performance in ambito multimediale.

  • ImageAdvanced Power e Thermal Management: Un’aggressiva gestione della potenza che include il supporto del nuovo “C6” power state e la tecnologia adattiva PowerSaver™, un nuovo meccanismo per la gestione della temperatura del die, che consente una migliore gestione termica.

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  • Upgrade scalabile dal processore VIA C7: La compatibilità pin-to-pin con gli attuali processori VIA C7 assicura agli OEM ed ai vendor di mainboard una transizione semplice e priva di complicazioni, consentendogli di offrire un’ampia gamma di prodotti per soddisfare le esigenze di mercati diversi con una singola board o design di sistema.

  • Tecnologia Verde: In aggiunta alla piena compatibilità con le normative RoHS e WEEE, la produzione sarà halogen-free e lead-free, a favore dell’ambiente e di una tecnologia eco-sostenibile.

  • ImageEnhanced VIA PadLock Security Engine: Accelerazione crittografica hardware on-die e caratteristiche per la sicurezza leader nel mercato, che comprendono dual quantum random number generator, un AES Encryption Engine, NX-bit, e hashing SHA-1 e SHA-256.

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Per maggiori informazioni sulla famiglia di processori VIA Nano, è possibile consultare il white paper al seguente URL:
http://www.via.com.tw/en/downloads/whitepapers/processors/WP080529VIA_Nano.pdf


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